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Beschreibung
Foi apresentada uma nova técnica de redução de potência chamada Voltage Scaling Stacked Transistor (VS-STACK). A técnica proposta foi comparada com algumas das técnicas de redução de potência existentes. O resultado mostra uma quantidade colossal de redução no consumo de energia para a porta NOR de 2input. O consumo de energia é reduzido em 20% a 90%. Além disso, há uma tremenda melhoria no produto de retardamento de potência. Por conseguinte, esta técnica pode ser utilizada para circuitos de alta velocidade. O circuito funciona na região do subthreshold, que é adequada para aplicações que requerem um consumo de energia extremamente baixo.
Details
| Verlag | Edições Nosso Conhecimento |
| Ersterscheinung | 19. Juli 2022 |
| Maße | 22 cm x 15 cm x 0.5 cm |
| Gewicht | 119 Gramm |
| Format | Softcover |
| ISBN-13 | 9786204996059 |
| Seiten | 68 |
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