Instruktionskompression für die synZEN Architektur

Diese Arbeit beschäftig sich mit einer parallelen Prozessorarchitektur nach dem Multiple Instruction Multiple Data (MIMD) Prinzip. Es gibt mehrere Funktionseinheiten die simultan Befehle ausführen können. Die Funktionseinheiten sind untereinander vernetzt, sodass Operanden eine Reihe von Funktionseinheiten durchlaufen können. Demzufolge gibt es mehrere Instruktionen (Befehlswörter) pro Takt - für jede FU ein Befehlswort. Es handelt sich um das Very Long Instruktion Word (VLIW) Konzept. In dieser Arbeit wird ein Kompressionsverfahren für diese Befehlswörter entwickelt. Dabei werden auf notwendige Modifikationen in Software und Hardware eingegangen. Zuerst wird der theoretische Entwurf diskutiert. Anschließend wird eine Realisierung an der Beispiel Architektur implementiert, wobei der Nutzen dem Aufwand gegenübergestellt wird. Zuletzt wird im Ausblick auf weiterführende Möglichkeiten eingegangen.