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Beschreibung
è stata presentata una nuova tecnica di riduzione della potenza chiamata Voltage Scaling Stacked Transistor (VS-STACK). La tecnica proposta è stata confrontata con alcune delle tecniche di riduzione della potenza esistenti. I risultati mostrano una riduzione colossale del consumo di energia per la porta NOR a 2 ingressi. Il consumo di energia viene ridotto dal 20% al 90%. Inoltre, si registra un enorme miglioramento nel prodotto del ritardo di potenza. Questa tecnica può quindi essere utilizzata per circuiti ad alta velocità. Il circuito opera in una regione di sottosoglia, adatta ad applicazioni che richiedono un consumo energetico estremamente ridotto.
Details
| Verlag | Edizioni Sapienza |
| Ersterscheinung | 19. Juli 2022 |
| Maße | 22 cm x 15 cm x 0.4 cm |
| Gewicht | 113 Gramm |
| Format | Softcover |
| ISBN-13 | 9786204996042 |
| Seiten | 64 |
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