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Desenho de lógica assíncrona de baixa potência para descodificadores Viterbi

Desenho de lógica assíncrona de baixa potência para descodificadores Viterbi

von Sakthivel Palaniappan und T. Kalavathi Devi Sakthivel
Softcover - 9786205860137
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Beschreibung

Este livro discute a concepção da lógica assíncrona e a sua importância na concepção digital. A maioria dos descodificadores concebidos e fabricados actualmente são síncronos. O problema da inclinação do relógio é um grande desafio na concepção síncrona. Alternativamente, os sistemas assíncronos estão a tornar-se familiares, pois não necessitam de relógio global, uma vez que estes sistemas são sincronizados localmente por meio de protocolos de comunicação. A arquitectura VLSI assíncrona para um descodificador Viterbi é concebida utilizando modelos Quasi Delay Insensitive (QDI) e Differential Cascode Voltage Switch Logic (DCVSL). Oferece uma visão geral da implementação assíncrona.

Details

Verlag Edições Nosso Conhecimento
Ersterscheinung 30. März 2023
Maße 22 cm x 15 cm x 0.4 cm
Gewicht 102 Gramm
Format Softcover
ISBN-13 9786205860137
Seiten 56