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Beschreibung
Une nouvelle technique de réduction de la puissance appelée Voltage Scaling Stacked Transistor (VS-STACK) a été présentée. La technique proposée a été comparée à certaines des techniques de réduction de puissance existantes. Le résultat montre une réduction colossale de la consommation d'énergie pour la porte NOR à 2 entrées. La consommation d'énergie est réduite de 20 à 90%. De plus, il y a une amélioration considérable du produit retard puissance. Cette technique peut donc être utilisée pour des circuits à haute vitesse. Le circuit fonctionne dans la région du sous-seuil, ce qui convient aux applications qui nécessitent une consommation d'énergie extrêmement faible.
Details
| Verlag | Editions Notre Savoir |
| Ersterscheinung | 19. Juli 2022 |
| Maße | 22 cm x 15 cm x 0.4 cm |
| Gewicht | 113 Gramm |
| Format | Softcover |
| ISBN-13 | 9786204996035 |
| Seiten | 64 |
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